Clock & Timing Phase noise 5G

Takt- und LO-Komponenten in 5G-Basisstationen (Teil 3/3)

Takteingangsüberwachung, Holdover und Relocking mit Abtasttakten

Clock input monitoring, holdover and relocking with sampling clocks

Überwachung und Relocking der Taktsignaleingänge sind für die Performance und das Zeitverhalten von Transceivern für 5G-Basisstationen von entscheidender Bedeutung. Erfahren Sie, wie die Parameter der Relocking-Periode eines HF-Abtasttaktgenerators/Jitter-Dämpfungsglieds mit dem Vektorsignalgenerator R&S®SMW200A mit Phasenrauschprofil-Option und dem R&S®FSWP Hochleistungs-Spektrum- und Phasenrauschanalysator gemessen werden.

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