信号&パワーインテグリティー

安定したきれいなパワーレール信号は、電子設計において性能を最適化するための根幹部分になります。ローデ・シュワルツは、パワーインテグリティー試験のためにベンチトップ用およびハンドヘルド用の広範なテストソリューションを提供しています。

通常、電子デバイスを通過する信号は、クロストーク、帯域幅限界、および信号線の不連続部によって減衰します。タイミング、ジッタ、反射損失と挿入損失、アイダイアグラム、クロストーク、不要な信号成分などを測定するための弊社の包括的なソリューションをご覧ください。

パワーインテグリティーのための電子計測ソリューション

正確で高速なパワーインテグリティー測定

正確で高速なパワーインテグリティー測定

電源分配回路に対する要求の高まりとともに、DCレールが小型化し、クリーンなパワーをICピンまで届けることを保証するレールが普及し始めています。今日の低電圧DCパワーレールのリップル、ノイズ、過渡信号の測定という課題に、これまでにない確度と速度で対応できます。

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DDRメモリのパワーインテグリティーの検証

DDRメモリを搭載したエンベディッドデバイスに関する重要な課題は、パワーレールやグランドレールの変動がある状況でシグナルインテグリティーを維持することです。このことは、供給電圧が低下し、スイッチング速度が上昇することにより、パワーレールの許容値とジッタの要件が厳しくなるとともに、さらに重要性を増しています。

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無料ガイド:Five techniques for fast, accurate power integrity measurements

レール電圧は低下し続け、許容値が減少しています。そのため、パワーレールの正確な測定が困難になりつつあります。これまでは、どのオシロスコープでも従来の5 Vレールのリップルを許容値10 %で測定できました。500 mVの要件が、オシロスコープのノイズレベルを十分に超えていたからです。

このガイドでは、オシロスコープを使って正確なパワーインテグリティー測定を行うための5つのヒントを説明します。

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シグナルインテグリティーのための電子計測ソリューション

クロックソースの検証

クリアーなクロック信号は、どのアナログ/デジタル回路設計の性能にとっても重要です。高速かつ高精度のジッタ性能測定(R&S®FSWP 位相雑音アナライザを使用)を利用してクロック信号を検証する方法について説明します。

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高速デジタルデザインのPLLの相加性位相雑音とジッタ減衰量の確認

高速デジタルデザインや無線通信でデータレートを上げるには、相加性位相雑音が低く、ジッタ減衰量の大きいSerDes PLLおよびクロック・シンセサイザが必要です。最新のデザインは、通常、2ステージアーキテクチャーに従い、ジッタ・アッテネータ・ステージと周波数シンセサイザーステージで構成されています。位相雑音感度が高いため、これらのテストには位相雑音アナライザが測定器として最適です。PLLへの信号印加には、超低位相雑音の追加信号源が必要となります。

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PCB上の高速デジタル回線の試験

データレートが絶えず上昇するため、高速デジタル設計や、使用するコンポーネントのシグナルインテグリティーへの対応は、ますます高まっています。とりわけ高いデータレートにおいて、コネクタ、ケーブル、PCBなどのパッシブコンポーネントを試験するためのタイムドメイン・レフレクトメトリ(TDR)のセットアップは、ベクトル・ネットワーク・アナライザ(VNA)に置き換えられ始めています。ユーザーは、VNAの高い精度、速度やESDに対する堅牢性が得られるので、VNAはこの分野において最適な計測器になっています。

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高速デジタルデザインにおけるクロックの真のジッタ性能の検証

高速デジタルデザインのデータレートが増加し、システム全体のジッタのリミットは厳しくなる一方です。

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関連製品

オシロスコープ

時間領域、ミックスドシグナル、シリアルバス、周波数の解析における使いやすさと優れた機能を備えた強力なローデ・シュワルツのオシロスコープを選択できます。

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オシロスコーププローブ

高品質アクティブ/パッシブプローブによって、ローデ・シュワルツのオシロスコープを最大限に活用できます。優れた仕様に加えて、信頼性と使いやすさも備えています。

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ネットワーク・アナライザ

高性能で幅広い機能を有するモデルや、最大48ポートをカバーするマルチポート・モデルなど幅広いラインナップで、500 GHzまでのパッシブやアクティブ・デバイスをテストできます。

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アナログ/デジタルデザインおよびテストの詳細

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トピック: アナログ/デジタル設計試験

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