Test di integrità del segnale

Integrità del segnale: test dell'albero di clock, PLL, convertitori A/D e D/A

Le più recenti tecnologie ad alta velocità richiedono sia clock di riferimento a bassissimo jitter che trasmettitori e ricevitori a bassissimo jitter nei circuiti integrati SoC (System on Chip). Sono necessarie nuove metodologie di test, che superino le limitazioni dei metodi esistenti per la misura del jitter e che siano in grado di ricavare le vere prestazioni di jitter di un segnale di clock di riferimento o del PLL SerDes. Le prestazioni richieste in termini di jitter devono anche essere raggiunte in un ambiente reale a livello di sistema, con la presenza di disturbi sull'alimentazione, che inducono jitter nel segnale di clock o nel PLL SerDes. L'influenza dei disturbi sull'alimentazione viene tipicamente caratterizzata dal rapporto di reiezione del rumore di alimentazione (PSNR). Con la crescente complessità delle tecnologie di trasmissione dati ad alta velocità, come Ethernet 112Gbps, viene utilizzata l'equalizzazione basata su convertitori A/D-D/A e i corrispondenti convertitori di dati analogico-digitali e digitale-analogici devono essere progettati e caratterizzati di conseguenza.

Con la sua grande competenza nelle misure sia nel dominio del tempo che della frequenza e lavorando a stretto contatto con gli organismi di standardizzazione, Rohde & Schwarz offre soluzioni efficaci per soddisfare le nuove sfide nei test dell'albero di clock, del PLL SerDes e dei convertitori A/D-D/A.

Documenti sul test dell'albero di clock, PLL e convertitori A/D e D/A

Verifica del rumore di fase additivo e dell'attenuazione del jitter dei PLL

Verifica del rumore di fase aggiuntivo e dell'attenuazione del jitter dei PLL nei progetti digitali ad alta velocità

I PLL SerDes in circuiti integrati SoC digitali ad alta velocità devono essere progettati per garantire un bassissimo jitter. Grazie alla sua elevata sensibilità al rumore di fase, l'analizzatore di rumore di fase R&S®FSWP è lo strumento ideale per effettuare questi test.

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Verifica delle reali prestazioni di jitter di PCIe Refclk

Verifica delle reali prestazioni di jitter del segnale di clock nei progetti digitali ad alta velocità

Con l'aumento della velocità di trasmissione dati, i limiti di jitter per i segnali PCIe Refclk si stanno facendo sempre più stringenti. Grazie alla loro superiore sensibilità al jitter, le specifiche PCIe Gen5 hanno introdotto il test basato sull’analizzatore del rumore di fase per verificare le reali prestazioni di jitter di un segnale Refclk.

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Misura della reiezione del rumore dell'alimentazione (PSNR)

Misurare il jitter indotto dall'alimentazione e il PSNR in oscillatori e clock a basso jitter

Gli oscillatori e i clock a basso jitter offrono le migliori prestazioni con linee di alimentazione pulite. Come parte di un progetto di sistema complessivo, devono anche funzionare in un ambiente di integrità di alimentazione non ideale e sopprimere correttamente il rumore di fase e il jitter indotti dall'alimentazione stessa.

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Verifica della sorgente di clock

Verifica della sorgente di clock

La purezza del segnale delle sorgenti di clock ha un impatto diretto sulle prestazioni complessive del sistema. Per assicurare un funzionamento adeguato, è necessario verificare che la purezza soddisfi i requisiti di progettazione.

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Confronto tra le misure di jitter nel dominio del tempo e della frequenza

Confronto tra le misure di jitter nel dominio del tempo e della frequenza

Il jitter può essere misurato sia nel dominio del tempo, sia in quello della frequenza. Mentre le misure TIE basate sull’oscilloscopio includono tutti i tipi di jitter, le misure di jitter basate sull'analizzatore di rumore di fase sono limitate ai segnali di clock, con una sensibilità al jitter senza rivali.

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Analizzatore di rumore di fase da 1 MHz a 50 GHz a conversione diretta con cross-correlazione

Analizzatore di rumore di fase da 1 MHz a 50 GHz a conversione diretta con cross-correlazione

L'analizzatore R&S®FSWP offre una gamma di frequenze di lavoro da 1 MHz a 50 GHz con mixer I/Q analogici a conversione diretta e campionamento del segnale in banda base. Il tradizionale concetto di PLL è sostituito da un demodulatore FM/AM digitale per la misura simultanea del rumore di fase e di ampiezza.

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Sistema di misura per il test del rumore di fase a frequenze superiori a 50 GHz

Sistema di misura per il test del rumore di fase a frequenze superiori a 50 GHz

Con i miscelatori esterni, l'analizzatore R&S®FSWP permette di effettuare misure del rumore di fase oltre i 50 GHz. La correlazione incrociata può essere utilizzata per ridurre ulteriormente il contributo del rumore di fase interno della configurazione di prova.

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Video su test dell'albero di clock, PLL e convertitori A/D e D/A

Signal integrity measurements with jitter analysis

Analisi del jitter con oscilloscopio R&S®RTO

Misura del jitter TIE con l'oscilloscopio R&S®RTO equipaggiato con l'opzione K12. Analisi del jitter TIE (Time Interval Error) di un segnale di clock in modalità statistica, tracciatura, istogramma e vista dello spettro per rilevare disturbi sul clock.

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